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alitium designer怎么让焊盘标识自动更新?

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发表于 2015-3-1 17:43:34 | 显示全部楼层 |阅读模式
本人使用的是AD13,画PCB封装时由于焊盘数目较多,所以选择粘贴和特殊粘贴。可是粘贴后的每个焊盘标识都一样。该怎么样让焊盘的标识不一样啊。详情见图片!

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这类问题 把案例提供上来方便网友参与... (截图只是补充说明用途,关键的是提供现成案例方便沟通)  发表于 2015-3-2 01:15
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发表于 2015-3-1 21:15:50 | 显示全部楼层
全部选中之后 使用SmartEdit编辑Pad的Name

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可否截几张图上来,暂时收集到 【起贴】Altium入门书籍准备贴 http://www.pcbbbs.com/forum.php?mod=viewthread&tid=270223&fromuid=63313 中, 全局编辑 部分...  详情 回复 发表于 2015-3-2 01:13
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发表于 2015-3-2 01:13:33 | 显示全部楼层
ziyu_00 发表于 2015-3-1 21:15
全部选中之后 使用SmartEdit编辑Pad的Name

可否截几张图上来,暂时收集到

【起贴】Altium入门书籍准备贴
http://www.pcbbbs.com/forum.php?mod=viewthread&tid=270223&fromuid=63313

中, 全局编辑 部分...
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发表于 2015-3-2 09:29:04 | 显示全部楼层
进来了解,这个我也不太清楚,学习!

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楼主的发帖 其实是没有看懂的,图片不清晰,也没有案例提供...  详情 回复 发表于 2015-3-2 10:18
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发表于 2015-3-2 10:18:41 | 显示全部楼层
pcb68 发表于 2015-3-2 09:29
进来了解,这个我也不太清楚,学习!

楼主的发帖 其实是没有看懂的,图片不清晰,也没有案例提供...
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 楼主| 发表于 2015-3-3 15:38:08 | 显示全部楼层
嗯 这个昨天反复试了一下,幸好这个封装有规律性。算是解决了。但是本质问题没有解决。我把这个封装传上来,大家看看.
现在这个封装的每个designator都是空的。怎么让系统自动把每个焊盘的designator自动标识。

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很高兴看到附件,现在还没有理解你遇到的问题? 从附件看,好像是有 3 个管脚组成的整列图,如果是这样,只需定义一个3个脚的器件,然后用整列布出PCB就能得到这样的排列了。 但从你之前的描述,这只是一个器件,  详情 回复 发表于 2015-3-3 18:29
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发表于 2015-3-3 18:29:52 | 显示全部楼层
Easonchan 发表于 2015-3-3 15:38
嗯 这个昨天反复试了一下,幸好这个封装有规律性。算是解决了。但是本质问题没有解决。我把这个封装传上来 ...

很高兴看到附件,现在还没有理解你遇到的问题?
从附件看,好像是有 3 个管脚组成的整列图,如果是这样,只需定义一个3个脚的器件,然后用整列布出PCB就能得到这样的排列了。
但从你之前的描述,这只是一个器件,可否 给个器件原理图 下的 器件封装(schlib)?

另外,封装建立不时很规范,比如 参考点位置未设定(如图),焊盘形式不是很理解(按说焊盘没有必要用两个焊盘叠加构成,用一个焊盘描述就可)。此类封装通过表格编辑可以得到定义,但因还是没有理解用意,暂置顶待后续你那边应用的再次说明...

方面的化可先简化下封装,需要您描述两个封装: schlib,  pcblib







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 楼主| 发表于 2015-3-3 21:06:39 | 显示全部楼层
现在每个焊盘的designator都是空的。我当初阵列粘贴后每个焊盘的designator都是一样的  软件就一直提示有警告  说designator重复了。我就索性全选把他们designator全部删除了。现在我就想每个焊盘的designator都自己标上号。 gerbe上传不了 压缩后还有2M多   再发个实物图 另外我没有画原理图.直接添加的网络。

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gerber压缩后体积大的原因:估计是有效文件和很多无用的文件堆积在一起的原因...  发表于 2015-3-3 22:29

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参与人数 1金钱 +200 兑换点 +5 收起 理由
wanghanq + 200 + 5 实物图很规整

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发表于 2015-3-3 22:26:24 | 显示全部楼层
Easonchan 发表于 2015-3-3 21:06
现在每个焊盘的designator都是空的。我当初阵列粘贴后每个焊盘的designator都是一样的  软件就一直 ...

感觉还是概念上有点模糊。

规整的测试板,如果不需要原理图,那在画PCB时也没有必要再人为添加网络,直接在无网络环境下完成连线。

这个板的体积不大,生成gerber后gerber体积应更小,压缩后体积大的原因
估计是有效文件很多无用的文件堆积在一起的原因

如果您不介意,你的这个文档 可以做为典型的概念模糊案例...

(这个测试板 用原理图方式生成PCB更简单快捷,仅包含一个3脚器件的排列测试版,你当前遇到的情况就不会发生)
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