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发表于 2002-8-27 22:04:00
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1. 几个电源管脚连在一起再打过孔接地会产生较大的共模噪声,增加了电源的电感,尤其是周围I/O分布较多的电源管脚,尽量不要连在一起接电源层/地。可以考虑离电容较近的就直接连电容再打孔接电源层,芯片靠里的电源管脚可以直接打孔连电源层,在BGA器件的正下方(Bottom层)放置较多的电容。这样可以减小回路面积,即减小了回路电感。如果有两个电源管脚相连也还可以接受,但不能过多。BGA的焊盘电源/地引线理论上越粗越好,不过不能太粗,不然焊接上会有问题,比如造成焊球偏移等等。
2. 对于大面积铺铜,要考虑的主要有三个方面:一是叠层的平衡问题,也就是从中间往两边看结构是不是对称的,如果一边多铺了一层铜,而另外一边铜较少,就可能受热膨胀而导致板子翘曲,一般可采用铺网格铜,或者对称铺铜处理,以达到近似平衡的效果;二是考虑走线的阻抗,铺铜会影响原先设计的阻抗,所以要注意控制铜皮和信号走线的距离; 三是铺铜(一般是铺地)时,要注意和其他地层良好接触,直径500mils之内至少要有一个接地过孔,不然阻抗会较高,同时还会增加EMI。对于你的SIG1/GND/SIG2/VCC/VCC/SIG5/GND/SIG6叠层设计,我想将一层GND和VCC交换位置效果会更好,即SIG1/VCC/SIG2/GND/VCC/SIG5/GND/SIG6,因为中间两层GND和VCC离得很近,会很有效的增大耦合,降低电源阻抗。
3. 我认为在相邻层布线没有太大必要,而且比较浪费空间。基本上对于微带线来说,保持一定的间距(比如4mils线宽,6mils线距)时,对于一般开关速度的器件来说,引起的串扰就不是很严重,但一个过孔会带来1nH左右的电感,30ps左右的上升沿减缓,但如果走内层,需要两个过孔,就会产生加倍的效果,所以我觉得与其换层,还不如增加间距。而对于一般信号4/6规则足以了,如果是时钟信号和其他走线之间,则可以再增大间距(12~20Mils)。另外层间的平行线影响往往更严重(因为多层板信号层之间的介质较薄),需要特别注意,内层的走线的间距要适当增大,比如4/8mils。你提到的“串扰的问题也可以通过减少层间厚度来解决”我想如果“层间厚度”指信号和参考平面(铺铜层)是正确的。但信号层之间的厚度减小引起的串扰就会大大增大。
4. 串联电阻放在什么地方不是一定的,之所以很多资料将放在驱动端,那是源端匹配,因为源端的阻抗较低,需要串接一个电阻保证和传输线的阻抗相同,以消除源端反射,而接受端的阻抗较大,一般加并联电阻以降低阻抗,但如果接受端阻抗较低,则也可以使用串联电阻匹配。另外,串联电阻很多时候并不是完全作为匹配用的,很多时候用作阻尼电阻之用,即降低电路的Q值,让振荡的能量迅速被阻尼吸收,以达到提高信号质量,减少振荡的目的。所以你也许没有必要再添加电阻,当然最好是经过仿真之后再确定。
以上只是我的一家之言,看看大家还有什么好的建议。 |
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